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西门子Aprisa推出新版本,持续加强在台研发投资

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西门子数位化工业软体近期推出 Aprisa 实体设计解决方案的最新版本——Aprisa 21.R1。该版本在效能及技术上均取得了重大进展,能够大幅改善执行时间并减少记忆体用量,将有助于客户降低设计成本并缩短上市时间。 

Aprisa 产品线是用于设计 IC 布局与绕线技术的领导者,提供完整的闸极级到 GDSII 架构的全功能模块级实体建置工具。自 2020年 12 月并购 Aprisa 产品组合以来,西门子大幅投资 Aprisa 技术,Aprisa 的研发团队规模目前已扩大两倍以上。作为 Aprisa 的重要目标市场之一,台湾亦十分注重该项技术研发,不仅建立多人研发团队,并计划持续新增研发人才,优化产品效能,因应 IC 领域不断上涨的需求。 

西门子 EDA 副总裁,台湾暨东南亚区总经理林棨璇表示:「客户正加速朝先进制程节点移转,如何解决日益提升的复杂度是一项重要挑战,随着物联网、5G、AI 等科技在台湾的不断实现,这种复杂性则会进一步增加。西门子 EDA 始终将客户需求放在第一位,我们将持续投资包括 Aprisa 在内的 IC 设计解决方案,从增强研发力量到加大渠道铺设,真正协助客户运用最领先技术在各先进节点上实现设计目标,进而促进台湾 IC 设计产业的发展。」 

新版 Aprisa 亮点包括:平均全流程的执行时间比前一版本减少 30%,而且对于更大型、更复杂的设计,其执行时间最多可提升两倍。可支援多重电源域(MPD)。这些延伸功能可大幅提升 MPD 支援的弹性与完整性,这点对极低功耗设计至为关键。

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针对全部布局与绕线的主要引擎均进行了改善,包括布局最佳化、时脉树合成(CTS)最佳化、布线最佳化以及时序分析。这些效能提升的优势几乎可以在所有 IC 设计中得以体现,特别是包含复杂多重边界多重模式(MCMM)特征的大型设计。对于这类复杂的设计,Aprisa 已被证实其速度最多可比上一代提升2 倍之多。

记忆体用量减少高达 60%;新版 Aprisa 与前一版本相比,可为大型设计平均减少 30% 的全流程尖峰记忆体使用量,为复杂设计则最多可减少 60%。此效率的大幅提升使得包含复杂 MCMM 的大型设计能够在可用记忆体较少的伺服器上完成。

支援 6 nm/5 nm/4 nm 设计。西门子与领先的晶圆代工厂密切合作,支援 Aprisa 执行先进节点的设计工作。目前 Aprisa  已通过 6 nm 制程的全面认证,在此之上,西门子已经实施所有必要的设计规则及功能,以便 Aprisa 可以支援 5 nm 与 4 nm 节点的设计,西门子正与全球领先的晶圆代工厂伙伴合作进行该方面的最终认证。

西门子数位化工业软体 Aprisa 产品系列部门总监 Inki Hong 表示:「这次 Aprisa 的全新版本再次表明了西门子致力于为 EDA 客户提供真正一流的实体设计技术。有了 Aprisa 21.R1,我们的客户可以比以往更有效率地完成更大型、更复杂的设计。」

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